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[editar] Prólogo

[editar] Índice de contenidos

1. Introducción
   1. Descripción
   2. Historia
   3. Otras alternativas
      1. ABEL
      2. AHDL
      3. Verilog
      4. Otros
   4. Tipos de descripción
      1. Descripción de comportamiento
      2. Descripción de flujo de datos
      3. Descripción estructural
2. Elementos básicos del lenguaje
   1. Comentarios
   2. Señales, variables y constantes
      1. Tipos de datos
      2. Ejemplos de escalares enumerados
      3. Ejemplos de flotantes
      4. Ejemplos de tipo físico
      5. Ejemplos de tipos compuestos
   3. Bases
   4. Operadores
3. Entidad
4. Arquitectura
   1. Diseño concurrente
      1. WHEN
      2. WITH
      3. Llamadas a funciones y procedimientos
      4. Process
      5. Asignación de señales
   2. Diseño secuencial
      1. PROCESS
         1. Lista de sensibilidad
         2. Variables
         3. Statements
            1. IF
            2. CASE
            3. LOOP
            4. EXIT
            5. ASSERT
            6. WAIT
   3. Diseño estructural
5. Subprogramas y paquetes
   1. Subprogramas
   2. Paquetes
6. Otros
   1. Sobrecarga
   2. GENERIC
   3. GENERATE
   4. Configuración
   5. Librerías
7. Bancos de pruebas
   1. Sentencias que ayudan a la depuración
   2. Ficheros
8. Síntesis
   1. Dispositivos
      1. Qué es un PLD (Dispositivo de Lógica Programable)?
      2. PROM (Programmable Read Only Memory)
      3. PLA (Programmable Logic Array)
      4. PAL (Programmable array Logic)
      5. Arquitectura de una FPGA
   2. Flujo de diseño
   3. Simulaciones
   4. Técnicas para tener un código sintetizable
9. Ejemplos
   1. Puerta triestado
   2. Puerto bidireccional
   3. Multiplexor
   4. Sumador
   5. Contador
   6. Biestable
   7. Memorias
   8. Máquinas de estados
   9. ALU
   10. CPU
10. Apéndices
    1. Atributos
    2. Paquete Standard Logic
    3. Instalación y uso de GHDL
    4. Bibliografía

[editar] Autores y licencia

• 2005 Rafa

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